{"id":626857,"date":"2023-05-14T18:57:43","date_gmt":"2023-05-14T18:57:43","guid":{"rendered":"https:\/\/magazineoffice.com\/el-concurso-busca-los-mejores-disenos-de-chips-generados-por-ia\/"},"modified":"2023-05-14T18:57:47","modified_gmt":"2023-05-14T18:57:47","slug":"el-concurso-busca-los-mejores-disenos-de-chips-generados-por-ia","status":"publish","type":"post","link":"https:\/\/magazineoffice.com\/el-concurso-busca-los-mejores-disenos-de-chips-generados-por-ia\/","title":{"rendered":"El concurso busca los mejores dise\u00f1os de chips generados por IA"},"content":{"rendered":"<p> <br \/>\n<\/p>\n<div id=\"article-body\">\n<p>El uso de bots de IA para escribir cartas comerciales o generar videos detallados de 4 segundos es cosa del pasado.  La pr\u00f3xima frontera es usar IA para ayudarlo a dise\u00f1ar silicio personalizado para sus proyectos.  Por eso Efabless<span class=\"sr-only\"> (se abre en una pesta\u00f1a nueva)<\/span>una empresa que fabrica chips personalizados por encargo, est\u00e1 organizando un concurso para animar a los fabricantes a dise\u00f1ar su propio silicio con la ayuda de la IA. <\/p>\n<p>Ganadores del desaf\u00edo de dise\u00f1o de silicio abierto generado por IA de Efabless <span class=\"sr-only\"> (se abre en una pesta\u00f1a nueva)<\/span> tendr\u00e1n sus chips fabricados de forma gratuita, un proceso que normalmente cuesta poco menos de 10.000 d\u00f3lares para los clientes de la empresa.  El concurso est\u00e1 abierto ahora, con entradas necesarias para el 2 de junio.<\/p>\n<aside class=\"hawk-nest\" data-render-type=\"fte\" data-skip=\"dealsy\" data-widget-type=\"seasonal\"\/>\n<p>\u00bfC\u00f3mo se usar\u00eda exactamente la IA para dise\u00f1ar un chip?  Lo crea o no, ChatGPT y Google Bard son capaces de escribir c\u00f3digo Verilog a pedido.  Verilog un HDL (lenguaje de descripci\u00f3n de hardware) que se puede utilizar en el proceso de fabricaci\u00f3n de chips, ya que explica los detalles clave sobre los circuitos y registros digitales. <\/p>\n<p>Cuando le ped\u00ed a Bard que me escribiera un c\u00f3digo Verilog de muestra, obtuve esto.  No s\u00e9 lo suficiente sobre Verilog para decir si es un buen c\u00f3digo o no.<\/p>\n<figure class=\"van-image-figure inline-layout\" data-bordeaux-image-check=\"\">\n<div class=\"image-full-width-wrapper\">\n<div class=\"image-widthsetter\" style=\"max-width:1641px;\">\n<p class=\"vanilla-image-block\" style=\"padding-top:88.18%;\"><picture><source type=\"image\/webp\" alt=\"Verilog code from Bard\" class=\" lazy-image-van\" onerror=\"if(this.src &amp;&amp; this.src.indexOf('missing-image.svg') !== -1)return true;;this.parentNode.replaceChild(window.missingImage(),this)\" data-normal=\"https:\/\/vanilla.futurecdn.net\/tomshardware\/media\/img\/missing-image.svg\" data-srcset=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-320-80.png.webp 320w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-480-80.png.webp 480w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-650-80.png.webp 650w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-970-80.png.webp 970w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-1024-80.png.webp 1024w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-1200-80.png.webp 1200w\" data-sizes=\"(min-width: 1000px) 970px, calc(100vw - 40px)\" data-original-mos=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3.png\" data-pin-media=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3.png\"\/><source type=\"image\/png\" alt=\"Verilog code from Bard\" class=\" lazy-image-van\" onerror=\"if(this.src &amp;&amp; this.src.indexOf('missing-image.svg') !== -1)return true;;this.parentNode.replaceChild(window.missingImage(),this)\" data-normal=\"https:\/\/vanilla.futurecdn.net\/tomshardware\/media\/img\/missing-image.svg\" data-srcset=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-320-80.png 320w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-480-80.png 480w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-650-80.png 650w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-970-80.png 970w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-1024-80.png 1024w, https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3-1200-80.png 1200w\" data-sizes=\"(min-width: 1000px) 970px, calc(100vw - 40px)\" data-original-mos=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3.png\" data-pin-media=\"https:\/\/cdn.mos.cms.futurecdn.net\/vXrDARurEPgxCc4B9UChS3.png\"\/><\/picture><\/p>\n<\/div>\n<\/div><figcaption itemprop=\"caption description\" class=\" inline-layout\"><span class=\"credit\" itemprop=\"copyrightHolder\">(Cr\u00e9dito de la imagen: Hardware de Tom)<\/span><\/figcaption><\/figure>\n<p>Efabless alberga una plataforma para crear y obtener conjuntos de muestra de chips de c\u00f3digo abierto dise\u00f1ados y fabricados.  La compa\u00f1\u00eda tiene varias lanzaderas al a\u00f1o donde los clientes pueden enviar sus dise\u00f1os a una f\u00e1brica y devolverlos unos meses despu\u00e9s.  El programa chipIgnite de la empresa le permite utilizar un n\u00facleo RISC-V, un flujo de dise\u00f1o automatizado y elegir entre 100, 300 o 1000 muestras de ingenier\u00eda. <\/p>\n<p>Una vez completada la fabricaci\u00f3n, obtiene troqueles empaquetados y algunas de sus piezas se colocar\u00e1n en placas de evaluaci\u00f3n que puede usar para las pruebas.  Luego puede usar las herramientas de c\u00f3digo abierto de la compa\u00f1\u00eda para probar su dise\u00f1o y actualizar el firmware.  La compa\u00f1\u00eda cobra $9,750 por proyecto chipIgnite. <\/p>\n<p>Si desea comenzar a intentar hacer su propio dise\u00f1o de chip, puede registrarse para obtener una cuenta gratuita en Efabless y consultar los muchos recursos y tutoriales de la compa\u00f1\u00eda.  Este video tutorial<span class=\"sr-only\"> (se abre en una pesta\u00f1a nueva)<\/span> parece particularmente \u00fatil.<\/p>\n<p>Tambi\u00e9n puede ver muchos de los dise\u00f1os de c\u00f3digo abierto que la gente ha hecho con Efabless, en su p\u00e1gina de proyectos.<span class=\"sr-only\"> (se abre en una pesta\u00f1a nueva)<\/span>.  Estos incluyen un generador de sprites VGA, un DAC de 10 bits con red neuronal anal\u00f3gica y un SoC de criptominer\u00eda. <\/p>\n<p>Para ser elegible para el Open Silicon Challenge generado por IA, los participantes deben tener al menos el Verilog para su chip generado por una IA y deben incluir todas las indicaciones o registros de sesi\u00f3n de GPT autom\u00e1ticos en el env\u00edo.  Sin embargo, puede realizar su verificaci\u00f3n fuera del entorno de IA.  Los dise\u00f1os deben ser de c\u00f3digo abierto para que cualquiera pueda reproducirlos y deben implementarse utilizando el flujo OpenLane chipIgnite. <\/p>\n<p>Las entradas ser\u00e1n evaluadas por un panel de expertos y los ganadores se anunciar\u00e1n el 9 de junio de 2023. No est\u00e1 claro de inmediato en las reglas cu\u00e1ntos ganadores habr\u00e1.  Todas las reglas e instrucciones para participar est\u00e1n en la p\u00e1gina del concurso.<span class=\"sr-only\"> (se abre en una pesta\u00f1a nueva)<\/span>.<\/p>\n<\/div>\n<p><br \/>\n<br \/><a href=\"https:\/\/magazineoffice.com\/\">Source link-41<\/a><\/p>\n","protected":false},"excerpt":{"rendered":"<p>El uso de bots de IA para escribir cartas comerciales o generar videos detallados de 4 segundos es cosa del pasado. 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