{"id":744124,"date":"2023-07-25T07:48:13","date_gmt":"2023-07-25T07:48:13","guid":{"rendered":"https:\/\/magazineoffice.com\/intel-avx10-isa-contara-con-instrucciones-avx-512-con-soporte-tanto-para-nucleos-p-como-para-nucleos-electronicos\/"},"modified":"2023-07-25T07:48:19","modified_gmt":"2023-07-25T07:48:19","slug":"intel-avx10-isa-contara-con-instrucciones-avx-512-con-soporte-tanto-para-nucleos-p-como-para-nucleos-electronicos","status":"publish","type":"post","link":"https:\/\/magazineoffice.com\/intel-avx10-isa-contara-con-instrucciones-avx-512-con-soporte-tanto-para-nucleos-p-como-para-nucleos-electronicos\/","title":{"rendered":"Intel AVX10 ISA contar\u00e1 con instrucciones AVX-512 con soporte tanto para n\u00facleos P como para n\u00facleos electr\u00f3nicos"},"content":{"rendered":"


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El pr\u00f3ximo AVX10 ISA (Arquitectura de conjunto de instrucciones) de Intel se ha detallado y viene con soporte AVX-512 para P-Cores y E-Cores.<\/p>\n

Intel AVX10 ISA podr\u00eda ser el gran arma de Chipzilla contra AMD, cuenta con soporte AVX-512 tanto en P-Core como en E-Core<\/h2>\n

En una diapositiva publicada por Twitterati, Longhorn<\/a>, podemos ver los detalles del pr\u00f3ximo AVX10 ISA de Intel que parece estar disponible en dos versiones, una habilitaci\u00f3n previa (AVX10.1) y una habilitaci\u00f3n posterior (AVX10.2). Ambos ISA tienen una adici\u00f3n importante que es la compatibilidad con FP\/int de 512 bits opcional, que es algo que se excluy\u00f3 de los chips de clientes recientes. El Intel AVX-512 ISA ha existido por un tiempo con Rocket Lake y Tiger Lake, pero la compa\u00f1\u00eda decidi\u00f3 deshabilitarlo de los chips de nivel de cliente m\u00e1s recientes, como Alder Lake y Raptor Lake.<\/p>\n

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Cr\u00e9ditos de imagen: Longhorn<\/figcaption><\/figure>\n

Pero parece que Intel podr\u00eda traer de vuelta estas instrucciones con procesadores compatibles con AVX 10 ISA. De acuerdo con los detalles previos y posteriores a la habilitaci\u00f3n, el AVX10 ISA es parte de las \u00faltimas APX (Advanced Performance Extensions) y ofrecer\u00e1:<\/p>\n