{"id":817928,"date":"2023-09-22T02:02:52","date_gmt":"2023-09-22T02:02:52","guid":{"rendered":"https:\/\/magazineoffice.com\/la-mayor-actualizacion-de-cpu-para-portatiles-de-intel-en-anos-supone-un-gran-cambio-con-respecto-a-disenos-anteriores\/"},"modified":"2023-09-22T02:02:56","modified_gmt":"2023-09-22T02:02:56","slug":"la-mayor-actualizacion-de-cpu-para-portatiles-de-intel-en-anos-supone-un-gran-cambio-con-respecto-a-disenos-anteriores","status":"publish","type":"post","link":"https:\/\/magazineoffice.com\/la-mayor-actualizacion-de-cpu-para-portatiles-de-intel-en-anos-supone-un-gran-cambio-con-respecto-a-disenos-anteriores\/","title":{"rendered":"La mayor actualizaci\u00f3n de CPU para port\u00e1tiles de Intel en a\u00f1os supone un gran cambio con respecto a dise\u00f1os anteriores"},"content":{"rendered":"<p> <br \/>\n<\/p>\n<div itemprop=\"articleBody\">\n<figure class=\"intro-image intro-left\"><figcaption class=\"caption\">\n<div class=\"caption-text\">Agrandar <span class=\"sep\">\/<\/span> Un procesador Intel Meteor Lake, que llegar\u00e1 al mercado bajo las marcas \u00abCore\u00bb y \u00abCore Ultra\u00bb a finales de este a\u00f1o.<\/div>\n<p>Intel<\/p>\n<\/figcaption><\/figure>\n<aside id=\"social-left\" class=\"social-left\" aria-label=\"Read the comments or share this article\">\n<\/aside>\n<p><!-- cache hit 278:single\/related:85082eae4ede32ace576cb8ed6f11d66 --><!-- empty --><\/p>\n<p>Los procesadores Intel para port\u00e1tiles Meteor Lake de pr\u00f3xima generaci\u00f3n est\u00e1n a punto de lanzarse: la compa\u00f1\u00eda anunci\u00f3 esta semana que los primeros procesadores se lanzar\u00e1n el 14 de diciembre. No est\u00e1 claro si los sistemas Core y Core Ultra reales estar\u00e1n disponibles para comprar en esa fecha, pero como m\u00ednimo. , el anuncio oficial allanar\u00e1 el camino para muchos anuncios de port\u00e1tiles en el CES en enero.<\/p>\n<p>Ya conocemos muchos datos b\u00e1sicos sobre Meteor Lake;  Utiliza una combinaci\u00f3n de chiplets fabricados por Intel y TSMC en lugar de una \u00fanica matriz monol\u00edtica, y marcar\u00e1 el retiro de la \u201cen\u00e9sima generaci\u00f3n\u201d de Intel y de las marcas i3\/i5\/i7\/i9.  Tambi\u00e9n sabemos que no estar\u00e1 listo para computadoras de escritorio y que la pr\u00f3xima ronda de CPU de escritorio Core ser\u00e1 muy similar a los chips de 12.\u00aa y 13.\u00aa generaci\u00f3n.<\/p>\n<p>Pero en el evento de Innovaci\u00f3n de Intel de esta semana, la compa\u00f1\u00eda profundiz\u00f3 un poco m\u00e1s en algunos de los avances de Meteor Lake, describiendo m\u00e1s sobre c\u00f3mo los chips equilibrar\u00edan los n\u00facleos E y P y anunciando su actualizaci\u00f3n de GPU integrada m\u00e1s sustancial en a\u00f1os.  A continuaci\u00f3n veremos algunos aspectos destacados, aunque vale la pena verlos o leer la presentaci\u00f3n completa para obtener m\u00e1s informaci\u00f3n.<\/p>\n<h2>Azulejos por millas<\/h2>\n<figure class=\"image shortcode-img full-width\" style=\"width:980px\"><img loading=\"lazy\" decoding=\"async\" alt=\"Meteor Lake fusiona cuatro matrices de silicio separadas utilizando una matriz base adicional.  Intel llama a esta tecnolog\u00eda de embalaje \" foveros.=\"\" src=\"https:\/\/cdn.arstechnica.net\/wp-content\/uploads\/2023\/09\/Screenshot-2023-09-20-at-1.48.28%E2%80%AFPM-980x504.jpeg\" width=\"980\" height=\"504\"\/><figcaption class=\"caption\">\n<div class=\"caption-text\">Agrandar <span class=\"sep\">\/<\/span> Meteor Lake fusiona cuatro matrices de silicio separadas utilizando una matriz base adicional.  Intel llama a esta tecnolog\u00eda de empaquetado \u00abFoveros\u00bb. <\/div>\n<p>Intel<\/p>\n<\/figcaption><\/figure>\n<p>Meteor Lake ser\u00e1 el primer procesador de consumo de Intel en pasar a un dise\u00f1o basado en chiplets; en lugar de ser un troquel monol\u00edtico que contiene la CPU, la GPU y todos los dem\u00e1s bits y piezas necesarios para una CPU de computadora port\u00e1til moderna, Meteor Lake se divide en cuatro. \u00abbaldosas\u00bb que se unen entre s\u00ed mediante una quinta loseta base que les permite comunicarse entre s\u00ed.  El proceso de apilar los chiplets encima del mosaico base es una tecnolog\u00eda de empaquetado que Intel llama Foveros.<\/p>\n<aside class=\"ad_wrapper\" aria-label=\"In Content advertisement\">\n    <span class=\"ad_notice\">Anuncio <\/span>    <\/p>\n<\/aside>\n<p>Aqu\u00ed hay un desglose b\u00e1sico de lo que hay en cada uno de esos cuatro mosaicos:<\/p>\n<ul>\n<li style=\"list-style-type: none;\">\n<ul>\n<li>El <strong>mosaico de c\u00e1lculo<\/strong> es donde est\u00e1 la mayor parte de la CPU real.  Las representaciones actuales de Intel muestran un chip con seis n\u00facleos P de alto rendimiento basados \u200b\u200ben la arquitectura Redwood Cove y ocho n\u00facleos E de alta eficiencia basados \u200b\u200ben la arquitectura Crestmont.<\/li>\n<li>El <strong>mosaico de gr\u00e1ficos <\/strong>Es donde ocurre la mayor parte del procesamiento de gr\u00e1ficos, aunque algunas funciones espec\u00edficas que normalmente encontrar\u00edas en una GPU se han movido a otros mosaicos.  La GPU integrada de Meteor Lake es principalmente una versi\u00f3n integrada de una GPU dedicada Intel Arc, completa con aceleraci\u00f3n de trazado de rayos por hardware.<\/li>\n<li>El <strong>mosaico IO<\/strong> maneja la mayor\u00eda de la conectividad externa, incluidas las l\u00edneas PCI Express 5.0 y la compatibilidad con Thunderbolt 4 (Thunderbolt 5 deber\u00e1 esperar).<\/li>\n<li>El <strong>mosaico de SoC<\/strong> Es probablemente el m\u00e1s interesante de los cuatro.  Incluye dos Crestmont E-cores adicionales, el motor de codificaci\u00f3n y decodificaci\u00f3n de medios que normalmente estar\u00eda ubicado en la GPU y la unidad de procesamiento neuronal (NPU) utilizada para acelerar las cargas de trabajo de IA y aprendizaje autom\u00e1tico.  Tambi\u00e9n maneja la conectividad Wi-Fi y Bluetooth y la conexi\u00f3n a pantallas externas a trav\u00e9s de HDMI 2.1 y DisplayPort 2.1.<\/li>\n<\/ul>\n<\/li>\n<\/ul>\n<p>Una de las cosas notables de Meteor Lake es que no todos los mosaicos son fabricados por Intel.  El mosaico de c\u00f3mputo, que alberga los n\u00facleos P reales y la mayor\u00eda de los n\u00facleos E, utiliza el nuevo proceso Intel 4, una actualizaci\u00f3n del proceso Intel 7 utilizado para la mayor\u00eda de los chips Core actuales.  Pero el mosaico de gr\u00e1ficos se fabrica en un proceso TSMC de 5 nm, mientras que el mosaico IO y el mosaico SoC se fabrican en un proceso TSMC de 6 nm.<\/p>\n<p>Intel tambi\u00e9n ha utilizado la fabricaci\u00f3n de TSMC para fabricar sus GPU Arc, por lo que no es la primera vez que vemos a estos dos enemigos de la fabricaci\u00f3n de chips trabajar juntos.  Pero Intel est\u00e1 tratando de ponerse al d\u00eda con la fabricaci\u00f3n de TSMC e Intel considera que sus operaciones de fundici\u00f3n son clave para su crecimiento futuro.  No me sorprender\u00eda que el objetivo final sea volver a los mosaicos totalmente fabricados por Intel.<\/p>\n<h2>Incluso m\u00e1s n\u00facleos electr\u00f3nicos<\/h2>\n<figure class=\"image shortcode-img full-width\" style=\"width:980px\"><img loading=\"lazy\" decoding=\"async\" alt=\"Hay un nuevo nivel de E-cores para Thread Director y tambi\u00e9n intentar\u00e1 enviar m\u00e1s trabajo a los E-cores sin afectar el rendimiento.\" src=\"https:\/\/cdn.arstechnica.net\/wp-content\/uploads\/2023\/09\/Screenshot-2023-09-20-at-1.52.28%E2%80%AFPM-980x508.jpeg\" width=\"980\" height=\"508\"\/><figcaption class=\"caption\">\n<div class=\"caption-text\">Agrandar <span class=\"sep\">\/<\/span> Hay un nuevo nivel de E-cores para Thread Director y tambi\u00e9n intentar\u00e1 enviar m\u00e1s trabajo a los E-cores sin afectar el rendimiento.<\/div>\n<p>Intel<\/p>\n<\/figcaption><\/figure>\n<p>Intel ha dicho que los n\u00facleos P de Meteor Lake no cambian mucho en comparaci\u00f3n con los utilizados en las CPU Alder Lake y Raptor Lake de 12.a y 13.a generaci\u00f3n; es posible que veamos velocidades de reloj m\u00e1s altas, pero no ha cambiado mucho en t\u00e9rminos de instrucciones. por reloj o conjunto de instrucciones.  Sin embargo, los E-cores obtienen algunas mejoras.<\/p>\n<aside class=\"ad_wrapper\" aria-label=\"In Content advertisement\">\n    <span class=\"ad_notice\">Anuncio <\/span>    <\/p>\n<\/aside>\n<p>Meteor Lake en realidad incluye dos tipos diferentes de E-cores.  Hay dos n\u00facleos E de bajo consumo (LP) en el mosaico de SoC, y la versi\u00f3n actualizada de Thread Director de Intel intentar\u00e1 utilizar esos n\u00facleos E para tantas tareas como sea posible.  Intel llama a esta parte del mosaico de SoC la \u00abisla de bajo consumo\u00bb porque la idea es permitir que el mosaico de c\u00f3mputo y el mosaico de gr\u00e1ficos se apaguen por completo tanto como sea posible para ahorrar energ\u00eda.<\/p>\n<p>Cuando las tareas requieren m\u00e1s rendimiento del que los n\u00facleos E de LP pueden proporcionar, Thread Director las enviar\u00e1 al mosaico de c\u00f3mputo, ya sea a los cl\u00fasteres principales de n\u00facleos E, que est\u00e1n ajustados para manejar cargas de trabajo multiproceso de bajo impacto, o a los n\u00facleos P. , que se utilizan para tareas de un solo subproceso y cualquier trabajo de subprocesos m\u00faltiples que los E-cores no puedan manejar.  Este es un cambio con respecto a la forma en que funciona Thread Director en los procesadores de 12.\u00aa y 13.\u00aa generaci\u00f3n, donde las tareas de alta prioridad se dirigir\u00edan directamente a los n\u00facleos P sin probar primero los n\u00facleos E.  (Aunque queda por ver si los cambios en Thread Director resultar\u00e1n en alg\u00fan tipo de retrasos perceptibles por el usuario para tareas de alto rendimiento).<\/p>\n<figure class=\"image shortcode-img full-width\" style=\"width:980px\"><img loading=\"lazy\" decoding=\"async\" alt=\"Para ahorrar energ\u00eda, se han agregado funciones al mosaico de SoC para que los mosaicos de gr\u00e1ficos y computaci\u00f3n se puedan apagar tanto como sea posible. \" src=\"https:\/\/cdn.arstechnica.net\/wp-content\/uploads\/2023\/09\/Screenshot-2023-09-20-at-1.50.56%E2%80%AFPM-980x509.jpeg\" width=\"980\" height=\"509\"\/><figcaption class=\"caption\">\n<div class=\"caption-text\">Agrandar <span class=\"sep\">\/<\/span> Para ahorrar energ\u00eda, se han agregado funciones al mosaico de SoC para que los mosaicos de gr\u00e1ficos y computaci\u00f3n se puedan apagar tanto como sea posible. <\/div>\n<p>Intel<\/p>\n<\/figcaption><\/figure>\n<p>Tambi\u00e9n vale la pena se\u00f1alar: los Crestmont E-cores se pueden agregar a los procesadores en grupos de dos, mientras que los Gracement E-cores de la generaci\u00f3n anterior solo se pod\u00edan agregar en grupos de cuatro.  Esto podr\u00eda hacer que a Intel le resulte m\u00e1s f\u00e1cil justificar la incorporaci\u00f3n de peque\u00f1os grupos de E-cores a procesadores de gama baja que no los ten\u00edan antes.  Todos los n\u00facleos E siguen siendo de un solo subproceso, mientras que los n\u00facleos P a\u00fan admiten dos subprocesos por n\u00facleo.<\/p>\n<p>Los nuevos E-cores tambi\u00e9n incluyen algunas otras sutilezas: instrucciones VNNI para acelerar cargas de trabajo de IA e incluso AVX10, que brinda muchos de los beneficios de las instrucciones AVX-512 de Intel sin requerir registros de 512 bits.  Los procesadores Core de 12.\u00aa y 13.\u00aa generaci\u00f3n desactivaron totalmente la compatibilidad con AVX-512 porque los E-cores no lo admit\u00edan, a pesar de que la compatibilidad <em>era<\/em> presente en los n\u00facleos P.  Esto ha creado una situaci\u00f3n inc\u00f3moda en la que los \u00faltimos chips Zen 4 de AMD admiten las instrucciones AVX-512 que Intel invent\u00f3 y promovi\u00f3, mientras que los \u00faltimos chips de consumo de Intel no lo hacen.<\/p>\n<\/p><\/div>\n<p><br \/>\n<br \/><a href=\"https:\/\/magazineoffice.com\/\">Source link-49<\/a><\/p>\n","protected":false},"excerpt":{"rendered":"<p>Agrandar \/ Un procesador Intel Meteor Lake, que llegar\u00e1 al mercado bajo las marcas \u00abCore\u00bb y \u00abCore Ultra\u00bb a finales de este a\u00f1o. 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