TSMC se prepara para lanzar una nueva y avanzada tecnología de chip de 2 nanómetros


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Según un nuevo informe de Taiwán, Taiwan Semiconductor Manufacturing Company (TSMC) comenzará la producción en masa de su proceso de semiconductores de 2 nanómetros en 2025. El cronograma coincide con el cronograma de TSMC, que su gerencia ha proporcionado varias veces durante las conferencias de analistas. Además, estos rumores sugieren que TSMC también está planeando un nuevo nodo de 2 nanómetros llamado N2P que entrará en producción el año posterior a N2. TSMC aún debe confirmar un nuevo proceso llamado N2P, pero ha utilizado nombres similares para sus tecnologías actuales de semiconductores de 3 nanómetros, siendo N3P una versión mejorada de N3 y reflejando refinamientos en el proceso de producción.

Se espera que los ingresos del segundo trimestre de TSMC caigan entre un 5 % y un 9 % según Morgan Stanley

El informe de hoy proviene de fuentes de la cadena de suministro de Taiwán y comparte que la producción en masa de semiconductores de 2 nanómetros de TSMC está programada. Los ejecutivos de la compañía han delineado el cronograma para el proceso de fabricación de próxima generación varias veces, incluso durante una conferencia en 2021 donde el director ejecutivo de la firma, el Dr. CC Wei, compartió que su firma confía en la producción en masa de 2 nanómetros en 2025.

Desde entonces, el vicepresidente sénior de investigación, desarrollo y tecnología de TSMC, el Dr. YJ Mii, confirmó este cronograma el año pasado, y la última opinión del Dr. Wei sobre el asunto se produjo en enero, cuando reveló que el proceso estaba «antes de lo previsto». y entrará en la etapa de producción de prueba en 2024 (también parte de la línea de tiempo de TSMC).

Los últimos rumores se basan en estas declaraciones y agregan que la producción en masa se realizará en las instalaciones de TSMC en Baoshan, Hsinchu. La planta de Hsinchu es la primera opción de TSMC para la tecnología avanzada, y la empresa también está construyendo una segunda instalación en el sector Taichung de Taiwán. Esta instalación, llamada Fab 20, se construirá en fases y fue confirmada por la gerencia en 2021, cuando la empresa adquirió terrenos para la planta.

El presidente de TSMC, el Dr. Mark Liu, en Tainan, Taiwán, en noviembre de 2022, como parte de una ceremonia de levantamiento de vigas para una extensión de fabricación de 3 nanómetros. Imagen: Liu Xuesheng/UDN

Otro dato interesante del informe es un supuesto proceso N2P. Si bien TSMC ha confirmado una variante de alto rendimiento del N3, denominada N3P, la fábrica aún debe proporcionar detalles similares para el nodo de proceso N2. Las fuentes de la cadena de suministro sugieren que N2P utilizará BSPD (suministro de energía en la parte trasera) para mejorar el rendimiento. La fabricación de semiconductores es un proceso complejo. Si bien la impresión de transistores que son miles de veces más pequeños que un cabello humano a menudo recibe la mayor atención, otras áreas igualmente complejas limitan a los fabricantes a la hora de aumentar el rendimiento del chip.

Una de esas áreas cubre los cables en una pieza de silicona. Los transistores deben conectarse a una fuente de alimentación, y su tamaño minúsculo significa que los cables de conexión deben ser igualmente más pequeños. Una limitación significativa a la que se enfrentan las nuevas tecnologías de proceso es la ubicación de estos cables. La primera iteración de un proceso generalmente ve los cables colocados sobre los transistores, y las generaciones posteriores los colocan debajo.

Este último proceso se llama BSPD, y es una extensión de lo que se denomina en la industria como a través de vías de silicio (TSV). Los TSV son conexiones que pasan a través de una oblea y permiten apilar varios semiconductores, como memoria y procesadores, uno encima del otro. Una BSPDN (red de entrega de energía en la parte posterior) implica unir las obleas entre sí y crea eficiencias de energía a medida que la corriente se entrega al chip a través de la parte posterior mucho más adecuada con menor resistencia.

Aunque los rumores apuntan a nuevas tecnologías de proceso, el banco de inversión Morgan Stanley cree que los ingresos de TSMC caerán entre un 5% y un 9% durante el segundo trimestre. El último informe del banco aumenta la caída esperada, que inicialmente se esperaba que fuera del 4% trimestre a trimestre. La razón detrás de la caída es un pedido reducido de las compañías de chips para teléfonos inteligentes,

Morgan Stanley agrega que TSMC puede reducir su guía de ingresos para todo el año 2023 de un «crecimiento leve» a plano y que su principal cliente, Apple, tendrá que aceptar un aumento del precio de las obleas del 3% más adelante este año. Según la nota de investigación, los rendimientos de TSMC para el nodo de proceso N3, utilizado en el iPhone, también han mejorado.

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